技術(shù)編號：6361927

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所公開的實施方式涉及電路設(shè)計，尤其涉及為電路設(shè)計選擇用于操作的時間約束調(diào)度的解決方案。背景技術(shù)對于數(shù)字電路(例如，超大規(guī)模集成(VLSI)技術(shù)的規(guī)模)的設(shè)計而言，設(shè)計者通常采用計算機輔助技術(shù)。已經(jīng)開發(fā)了描述數(shù)字電路的標(biāo)準(zhǔn)語言(諸如硬件描述語言(HDL))來幫助設(shè)計和模擬復(fù)雜的數(shù)字電路。若干硬件描述語言(例如，VHDL(非常高速集成電路HDL)和Verilog HDL)已經(jīng)演進(jìn)為工業(yè)標(biāo)準(zhǔn)。VHDL和Verilog HDL是通用硬件描述語言，其允許通過使用抽象...
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