結構化系統的設計方法

            文檔序號:6412558閱讀:298來源:國知局
            專利名稱:結構化系統的設計方法
            技術領域
            本發明涉及集成電路設計方法,尤其涉及集成電路結構設計的交互式方法。
            當代集成電路的復雜性導致基于使用高層綜合方法的結構化設計的發展,以減少設計周期。例如,典型的高層綜合方法用集成電路行為的算法描述生成一個寄存器傳輸級(RTL)硬件的電路方案。該方法包括一系列設計任務,例如,調度,資源配制,鏈接(把行為語句映射到具體的硬件元件),及控制器的生成。這些設計任務的復雜性與所設計的集成電路的復雜性密切相關。
            用于高層綜合的現有技術方法的輸入由一組描述具體的集成電路性能的行為語句及約束條件組成。這一系列設計任務自動執行,最后提出一個硬件方案。每一個設計任務都產生數據,這些數據與行為語句的關系越來越難被認出,因此設計者很難把特定的硬件元件與具體的描述語句聯系起來。如果在硬件方案中檢測到設計錯誤,設計者很難確定應改變的行為語句。硬件元件與行為語句間對應的低可視性使得硬件優化成為試錯過程,這些試錯過程要求自動化設計任務的幾次迭代。相當大部分的設計任務用于重復計算集成電路的和原先的迭代相同的部分。計算資源支出在時間的消耗及成本上。
            因此,為了減少設計時間及成本,有必要發明一種同每一個設計任務產生的數據有多重交互的結構化設計方法,以增加硬件與行為間對應的可視性。


            圖1表示一個交互式結構化設計系統的方框圖;圖2表示該交互式結構化設計系統的流程圖;圖3表示分配給一個算法描述的控制步驟的時序圖;圖4表示該算法描述的硬件方案的原理圖;圖5表示修改后的算法描述的硬件方案的原理圖6表示用于實現交互式結構化設計系統的計算機的方框圖。
            圖1表示一個交互式結構化設計系統10的方框圖,由多個直觀的輔助的編輯器組成,其中每一個都控制一個不同的設計任務。微結構設計數據庫12包括存儲在一個公共數據庫中的各種類型數據的存儲器。例如,表示集成電路的行為,結構及定時數據類型都存儲在微結構設計數據庫12中。通過層次編輯器14,行為編輯器16,結構編輯器18,時序編輯器20,提取庫編輯器22及設計工具包24都可以對數據進行讀或寫訪問。存儲在微結構設計數據庫12中的數據以每一個編輯器和設計工具包24都接受的預先確定的格式存儲。
            層次編輯器14用于把集成電路設計劃分成分層模塊。設計者一般根據設計規范及特定模塊的行為的復雜性劃分電路。例如與總線接口的數字信號處理器(DSP)芯片可以進一步劃分成總線接口模塊及DSP芯片模塊。在層次編輯器14中產生的數據存儲在微結構設計數據庫12中,用于進一步處理。通過層次編輯器14的圖形界面可以從微結構設計數據庫12中重新調用分層數據,用來對特定的模塊進行觀察或重新劃分。
            層次編輯器14定義的描述單獨模塊的算法行為的數據存儲在微結構設計數據庫12中。為了在顯示器上觀察,行為數據以圖形或文本格式提取和安排。由于行為數據是作為一系列用來定義具體功能或操作的語句輸入的,因此行為編輯器16一般具有內部語法檢查。一般在層次編輯器14中定義了分層模塊后生成行為數據。
            結構編輯器18管理微結構設計數據庫12中存儲的寄存器傳輸級(RTL)數據。RTL數據表示在層次編輯器14中產生的分層模塊的硬件元件。設計者交互式提供或編輯RTL數據,或通過設計工具包24中的設計工具利用微結構數據庫12中存在的數據產生RTL數據。為了在結構編輯器18中通過圖形界面顯示成原理圖,RTL數據以圖形或文本格式安排。
            時序編輯器20為在行為編輯器16中生成的行為語句的基于周期的定時提供編輯環境。定時數據存儲在微結構設計數據庫12中,由設計者交互式提供或由設計工具包24中的工具提供。時序編輯器20包括一個圖形界面,用來以圖形或文本格式顯示定時數據,以此觀察及安排該算法描述的相對調度。
            提取庫編輯器22為RTL庫元件的存取、編輯或生成提供環境。RTL元件存儲在微結構設計數據庫12中。庫元件數據包括RTL庫元件的屬性,例如延時、定時方法等等。通過提取庫編輯器18的圖形界面來訪問庫元件數據,用來交互式觀察及編輯。
            設計工具包24包括結構設計10使用的可執行程序以使特定的設計任務自動化。例如,設計工具包24包括生成行為語句的周期調度的工具。由于時序圖與行為語句有關,通過時序編輯器20來觀察調度。設計工具包24中的另一個工具產生劃分開的模塊的RTL結構,其原理圖在結構編輯器18中觀察及編輯。設計者使用適當的編輯器可以交互式地修改設計工具包24中的工具自動生成的數據。
            設計工具包24中的一個重要的工具是控制發生器,控制發生器生成由狀態機組成的控制單元,為了實現規定的行為和定時,狀態機在規定的時間給RTL元件提供控制信號。控制生成一般是自動的,并且作為設計過程的最后階段完成。
            圖2表示由步驟202-212組成的微結構設計系統10的設計流程圖,通過執行一個步驟及轉移到任何其它步驟,可以以不同的次序來完成。在步驟202,對層次編輯器14劃分出的每一個模塊都生成或編輯其行為或算法描述。行為數據以一組操作或功能語句通過行為編輯器16輸入,這些語句一般用文本方式的編程語言寫成,例如C語言。行為數據也可以用流程圖以圖形方式輸入。通過行為編輯器16中的圖形界面來觀察或編輯該算法描述。
            在步驟204,控制步從劃分出的模塊的算法描述映射到系統時鐘的特定周期。控制步映射由行為語句與完成該語句的特定時鐘周期的鏈接關系定義。控制步描述了用于完成由行為語句定義的功能或操作的周期定時。表示控制步的時序圖在時序編輯器20中觀察或編輯。
            在步驟206,根據設計規范來配置RTL元件。在實現一個設計時所用的每一類RTL元件的數量都由控制步映射(步驟204)的結果確定。當前的RTL元件配置都存儲在微結構設計庫12中,用結構編輯器18檢查。設計規范經常對設計中使用的RTL元件的數量提出限制。為了把限制加到設計中去,RTL元件的數據在結構編輯器18中提取并交互式地編輯,以修改RTL當前元件配置。
            通過執行設計工具包24中的互連工具能自動產生RTL元件的互連。互連工具能產生全新的結構,或者也能把新的互連加到已存在的不完全的互連結構中。反過來,為了觀察及修改已有的互連,設計者也可以用結構編輯器18交互式地提供所有或部分互連。互連步驟208包括產生在當前RTL元件間傳送信號的導線。此外,在互連步驟208還產生為實現RTL元件的共享及通信協議所需要的開關器件,例如多路器與三態器件。根據設計規范生成導線及開關器件,與此同時要考慮由控制步映射及行為到結構的映射步驟204及210產生的限制。互連數據存儲在微結構設計數據庫12中。
            結構映射(步驟210)將模塊行為描述中的變量及操作與具體的RTL元件相聯系。因此,在行為編輯器16中觀察及編輯的算法或行為語句與在結構編輯器18中觀察及編輯的RTL元件有聯系。在顯示器上可以同時觀察RTL元件及行為語句。當在顯示器的一個區域中選中特定的RTL元件時,在顯示器的另一個區域中相關的行為語句被加亮,清楚地表示出行為語句與RTL元件間的聯系。這些聯系使控制發生工具(步驟212)產生實現該設計規定的行為,定時及資源配置的控制單元。設計工具包24中的映射工具自動產生行為語句與具體的RTL元件間的聯系。另一方面,也可以用結構編輯器18及行為編輯器16規定用特定的RTL元件來完成特定的行為操作,交互式地定義所要求的聯系,以使用設計規定的元件。
            通過給結構設計系統10中的每一個編輯器提供一個用戶界面,本方法允許設計者在設計的每一個階段對每一個設計任務產生的數據進行觀察和/或修改。在一個原始設計中,步驟202-212經常是自動或交互式地順序完成。在某些情況下,當從草案開始一個新的設計時,順序執行步驟202-212是足夠的。
            然而,設計工作的很重要的部分是修改或改進已存在的RTL方案,以符合新的規定。這種修改或改進經常要求只改變已存在的RTL方案的一部分。現有技術中的設計系統順序執行步驟202-212,因此對修改就好象對一個初始設計一樣。任何改變都要求設計者從步驟202重新開始。因此設計和計算資源浪費在對于RTL方案的不需改變的那部分的重復計算上。此外,設計者還不能防止現有技術的設計系統改變方案中需要重新使用的部分。
            結構設計系統10的一個特點是用于存儲微結構設計數據庫12提供的設計數據的共用數據庫。由于每一個編輯器都訪問及解釋同樣的設計數據,從而確保了設計數據的行為、定時、結構及映射類型的一致性。微結構設計數據庫12包括一個或多個表格,其中存有每一個設計數據元素的屬性。步驟202-212中的每一個步驟都可以增添或刪除這些屬性。例如,如果設計者修改一個行為語句映射的一個特定的控制步,那么該語句映射的已存在的控制步從表格中刪除,并加入新的映射。表格中未被改變的屬性保持不變。因此在接下來執行步驟202-210的設計任務時,只有那些被改變的屬性被更新。在另外的實施方式中可以使用旗標或其它指示器來跟蹤屬性的變化。美國專利5533179號公開了只修改需改變的屬性的例子。
            每一個編輯器都有一個用戶界面,讓設計者確定要完成哪些設計任務及要完成設計的哪一部分。在設計的任何步驟,每一個編輯器都能訪問共用數據庫以提供設計數據的可靠的交互式編輯,以使設計任務不必以任何特定的順序執行。例如,設計者可以先執行步驟206,然后再按步驟208、202、204、210、及212的順序進行轉移。
            結構設計系統10的另一個特點是不需重復有關的設計數據未變的設計任務。尤其是設計工具包24中的工具和每一個編輯器相關,允許設計者選擇和控制完成特定設計任務的設計的這些部分。因此未改變的設計部分不用重新計算。取消了不必要的或冗長的設計任務,更有效地利用了設計和計算資源。
            這里有一個為了用于不同的應用,修改一個現有的集成電路設計的例子,通過該例子可以理解設計任務的順序可改變的優點。首先在層次編輯器14中把現有設計劃分成固定的及可編程的部分,這樣固定部分在不同的應用中重復使用,只有可編程部分改變。在這樣劃分的系統中,首先執行步驟206和208,以配置及互連固定部分包括的RTL元件。其次執行步驟202,以根據特定應用的設計規范定義特定的行為。然后通過執行步驟204和210設置控制步及結構映射以形成數據庫,生成可編程的部分。最后在步驟212產生控制單元。
            在另一個例子中也可以看到以可變順序完成設計任務的優點,這里一個新指令要被加到用本發明介紹的設計方法設計的已有的微處理器中,其數據庫存在微結構設計數據庫12中。現有技術方法要求以從步驟202到212的順序執行設計任務,以完成微處理器的完整再設計。現有的技術方法效率低,尤其當已有的微處理器的大部分原先已作過大量的調試及優化時。
            如果原先的優化部分未被新的指令改變,本方法允許設計者保留原先的優化部分。設計工具包24中的工具都有一個選擇模式,在這種模式中一種工具只對設計者用一種編輯器選擇的數據操作。在加一個新指令到一個已有的微處理器中的例子中,設計者選擇微處理器需要實現新指令的那部分。為了只修改設計者選擇的部分,在選擇模式下應用適宜的工具。
            例如,用行為編輯器在步驟202把描述新指令的行為語句加到已有的微處理器的算法描述中。設計者通過行為編輯器16的用戶界面交互式地確認和選擇新的行為語句。在選擇模式下執行步驟204,以把所選擇的語句映射到控制步。假定不需要用另外的RTL元件來實現新加的指令,執行步驟210,以使只有選擇的新的行為語句被映射到已存在的RTL方案。通過執行步驟212產生能使已有的RTL結構實現修改后的指令組的新的控制器。這種情況下,僅執行步驟202,204,210及212就實現了新設計,同時保留了微處理器原來被優化和調試過的部分。
            下面通過一個例子來說明用本發明來產生和編輯設計數據庫的過程,例中設計一個電路,它計算在輸入端INP1和INP2分別輸入的兩個值的平方函數的差。用行為編輯器16提供所要求的函數的算法描述(步驟202),該算法描述由下面表1中的語句1到語句5組成。
            表11.X=INP12.Y=INP23.X1=X*X4.Y1=Y*Y5.OUT=X1-Y1一旦算法描述輸入到設計數據庫中,根據對于特定的設計任務所加的設計限制執行步驟204-212,自動生成RTL方案。或者,設計者也可以交互式地定制該算法描述及RTL方案的特定方面。例如假定設計者交互式地限制該RTL方案,使每到第四個周期提供一個輸出,及使用一個單獨的二周期流水線乘法器電路。首先通過執行步驟204完成控制步映射,然后在步驟206配置RTL元件。
            圖3是表示用于表1的算法語句的控制步映射的時序圖300。為清楚起見,執行每個語句的系統時鐘周期用陰影表示。波形301和302表示在周期T1期間在輸入端INP1和INP2分別接收到輸入值X和Y。波形303表示在周期T1和T2完成乘法X1=X*X。波形304表示在周期T2和T3完成乘法Y1=Y*Y。由于用同一個二周期流水線乘法器完成二個乘法,所以波形302和303在周期T2期間重疊。由于設計者提出第四周期的限制,所以波形305表示OUT=X1-Y1在周期4產生。
            一旦控制步映射結束,通過規定特定的RTL元件交互式地完成步驟206,如用結構編輯器18產生一個二周期的流水線乘法器。所要求的減法器電路及用于存儲中間值Y,X1和Y1的兩個寄存器也交互式地配置。作為另外一個過程,用設計工具包24中和每一步驟有關的工具執行執行步驟206-212,自動完成RTL方案。
            假定交互式地配置流水線乘法器,減法器及兩個寄存器,結構映射(步驟210)經常在生成互連(步驟208)前完成,以把在步驟206配置的具體的RTL元件鏈接到特定的算法操作。例如,在步驟206配置的流水線乘法器映射到表1的行為語句3和4的乘法操作。類似地,表1的行為語句5的減法操作可以鏈接到在步驟206配置的減法電路,以及中間值Y,X1,X2可以映射到步驟206配置的特定的寄存器。
            在圓滿完成了行為描述,控制步映射RTL元件配置及結構映射后,互連和控制單元自動生成(步驟208,212),以完成該RTL方案。從上面的例子中可以看出。本發明的方法不要求嚴格按圖2表示的次序從步驟202到212順序執行,而是允許設計者從一步轉移到順序中的任何其他步驟,以最有效地完成集成電路設計。例如,在上面描述的過程中,步驟210就在步驟208前完成。
            圖4是一個原理圖,舉例說明在一個集成電路實施方式中,由時序圖300所示的定時約束的表1的行為語句1到5的RTL方案400。RTL方案400包括流水線乘法器401,減法器402,寄存器403和404,三態驅動器405,控制單元406及多路器407,408及409。輸入端INP1接收值X,輸入端INP2接收值Y。根據表1中的行為語句1到5定義的算法輸出端提供計算結果OUT=X2-Y2。周期定時由系統時鐘提供。
            根據執行本發明的上述步驟配置RTL元件。特別是在步驟206交互式地配置流水線乘法器401,以執行表1中行為語句3和4的乘法操作。同樣,在步驟206交互式地配置減法器402,以完成表1中行為語句5的減法功能。在步驟206還配置寄存器403和404,以存儲表1的中間值Y,X1和Y1。在步驟208自動生成互連導線和多路器407-409。
            控制單元406自動生成,給用于實現規定的算法描述和定時的特定元件提供控制信號C1-C6。例如,三態驅動器405有一個控制輸入端,它在周期T4從控制單元406接收控制信號C2,以把計算結果OUT送到輸出端,或把三態驅動器405設置為三態模式。
            原理5表示表1中語句1-5的RTL方案500,其中改變設計規范,要求計算結果OUT在輸出端存儲并顯示4個周期。用圖4所示的已有的RTL方案400的數據庫作為出發點,可以看出,通過配置一個新寄存器505取代RTL方案400中的三態驅動器405實現了設計規范的改變。因此,設計者直接執行步驟206,交互式地從數據庫中刪除三態驅動器405,并用結構編輯器18配置寄存器505。由于不發生變化的步驟202和204可以被旁路,所以直接轉移進入到特定的設計任務提高了設計效率。
            在步驟208,用結構編輯器18加入導線504,把寄存器505連接到減法器402。同樣,用結構編輯器18從已有的數據庫中交互式地修改或生成導線501-503。應注意的是,在步驟206和208,只需要編輯RTL方案500中被修改的部分。下面的操作可以在選擇模式下完成,這樣,只有相應于選中的新元件的數據要重新計算。未改變的余下的RTL元件仍保留在數據庫中,并且仍然用在RTL方案500中。較少的及局部的修改的結構映射(步驟210)通常交互式地完成,以規定計算結果OUT=X2-Y2存在寄存器505中。
            雖然原先執行過步驟212,自動生成了RTL方案400中的控制單元406,但由于要完成不同的功能,步驟212還要重新執行以生成控制單元506。特別是在周期T4,控制單元406使三態驅動器405輸出,而控制單元506在導線502上對寄存器505提供控制信號C7,用來在時鐘周期T4存儲計算結果OUT,直到接收到下一個控制信號C7。
            上面的例子表明設計者能交互式地操縱微結構設計數據庫12,以修改RTL元件,使產生不同結構的RTL方案400和500。用結構編輯器18交互式地修改特定的RTL元件及互連,而不修改算法描述中的語句,產生不同的機構。具體來說,用結構編輯器18把寄存器505和導線501-504交互式地加到設計數據庫中,修改RTL方案400,然后轉移到其他設計任務,完成RTL方案500的設計。
            本發明也能產生和用現有技術方法產生的電路結構不同的RTL方案。例如,用現有技術的設計方法能產生實現表1的行為語句所描述的功能相同的電路的原理圖。用行為語句作為輸入數據執行現有技術的設計程序,表示電路原理的數據在輸出端產生。該輸出數據形成具有特定的現有技術設計程序規定的結構特性的方案。
            相反,用本發明產生的RTL方案的結構不受特定的設計程序限制,而仍能被設計者修改和優化。設計者在交互式地修改設計數據庫的過程中轉移到適宜的步驟。更具體地說,如上所述,設計者能轉移到結構編輯器18,交互式地修改RTL方案和互連,而不修改算法描述中的語句。結果,可以修改一個設計,以產生一個RTL方案,其結構與用現有技術方法產生的結構完全不同。
            一個RTL方案一般由集成電路的原理圖組成。從這樣的原理圖產生的數據用來制造光刻掩膜,以在用于制造集成電路的半導體襯底上制造該RTL方案的物理結構。用于產生RTL方案的本設計方法包括制定集成電路的制造過程的設計部分,該集成電路包括該RTL方案。
            圖6表示用于設計集成電路的具有結構設計系統10的計算機600的方框圖,包括控制電路602,輸入裝置604,輸出裝置606及存儲器608。輸入裝置604用于把輸入數據送到計算機600。在此設計者交互式地輸入數據,輸入裝置604一般是一個鍵盤。然而,輸入裝置604也可以是其它類型的輸入裝置,例如磁盤機或磁帶機,調制解調器或掃描儀。輸入數據從輸入裝置604藕合到控制電路602,該控制電路執行存儲在存儲器608中的一個決定如何處理輸入數據的編輯程序。
            輸出裝置606一般包括顯示監視器,用于交互式地顯示從控制電路602接收到的表示所設計的集成電路結構系統的數據。輸出裝置606可以是其它類型能顯示或傳送在計算機600中產生或存儲的數據的裝置,例如打印機,調制解調器,及磁盤機或磁帶機。
            控制電路602執行存儲在存儲器608中用于實現包括在結構設計系統10中的設計任務的軟件程序。通過執行一個工具程序自動完成該設計任務,該工具程序存儲在存儲器608中用于存儲設計工具包24的那個區域。控制電路602一般由微處理器構成,但控制電路602的功能也可由其他類型的邏輯電路提供,包括狀態機。控制電路602也執行存儲在存儲器608中的編輯程序,它提供計算機600和交互式地完成設計任務的設計者之間的圖形界面。這樣的編輯程序包括層次編輯器14,行為編輯器16,結構編輯器18,時序編輯器20及提取庫編輯器22。
            控制電路602管理進入計算機600的數據流及從輸入裝置604接收到的輸入數據,并顯示傳送到輸出裝置606的數據。在工具程序或編輯器的指引下。控制電路602提取,修改及存儲存在被稱為微結構設計數據庫12的存儲器608中的共用設計數據庫中的數據存儲器608包括上述用來存儲用以實現結構設計系統10的數據和軟件程序的存儲器區域的大部分。存儲器608可能包括隨機存取存儲器,只讀存儲器,磁存儲介質,例如軟盤,硬盤及磁帶,還可能包括光存儲介質,例如光盤,及類似的存儲裝置。
            現在應該已經明確,實現結構設計方法的計算機是用于設計集成電路的。通過完成一組設計任務由該結構系統的算法描述提出該集成電路的算法描述及該集成電路的RTL方案。這些設計任務并不需要以特定的順序完成。而是為了完成這些設計任務,設計者可以任何適宜的次序交互式地從一個設計任務轉移到另一個任務。
            該結構設計方法進一步還允許設計者通過直接執行適宜的步驟,及通過與該步驟有關的編輯器的用戶界面交互式地按要求改變,以交互式地更有效地修改已有的RTL方案。設計者交互式地確定要修改的部分,以任何次序交互式地轉移到其它步驟,僅對要修改的部分完成修改后的RTL方案,完成設計任務。
            雖然這里表示和描述了本發明的具體實施方式
            ,但熟練的技術人員會作出進一步的修改和改進。可以理解,本發明并不僅限于所指出的特定形式,本發明的權利要求覆蓋不違反本發明的實質和范圍的所有修改。
            權利要求
            1.一種在結構級設計系統的計算機實現方法,其特點是以下步驟從該系統的算法描述通過多個設計任務(202-212)產生該系統(400)的寄存器傳輸級(RTL)方案;及從多個設計任務(202-212)之一轉移到多個設計任務中的另一個(202-212),以不同的次序執行多個設計任務。
            2.權利要求1的方法,其中每一個設計任務都包括多個設計判斷,及轉移步驟包括在多個設計任務(202-212)之一中交互式地定義或修改多個設計判斷之一并轉移到在多個設計任務(202-212)的另一個中的多個設計判斷中的另一個。
            3.權利要求1的方法,其中多個設計任務(202-212)包括以下步驟產生及編輯算法描述(202);及由算法描述生成控制步映射(204)。
            4.一種在結構級設計系統的方法,其特點是以下步驟從該系統的算法描述通過每一個都包含多個設計判斷的多個設計任務產生該系統(400)的寄存器傳輸級(RTL)方案;及在多個設計任務(202-212)中交互式地定義或修改多個設計判斷。
            5.權利要求4的方法,其中多個設計任務(202-212)包括以下步驟配置RTL元件(206);生成并編輯算法描述(202);由算法描述及RTL元件產生控制步映射(204);在RTL元件間產生互連(208);由對該RTL元件及互連的算法描述產生結構映射(210)。
            6.權利要求4的方法,其中多個設計任務包括產生控制單元(212)以使該RTL元件能實現該算法描述的步驟。
            7.一個可讀的計算機存儲介質,其特點為存儲器(24)的第一個區域用于存儲多個計算機可執行的設計任務(202-212),用于產生描述由一個結構系統的算法描述來的該結構系統的共用設計數據庫(12);及存儲器(14-22)的第二個區域用于存儲多個用于交互式地觀察及修改該共用設計數據庫(12)并用于以不同的次序執行這些計算機可執行的設計任務(202-212)的多個數據編輯器(14-22)。
            8.一種根據以下步驟設計的集成電路由該集成電路的算法描述通過每一個都包含多個設計判斷的多個設計任務(202-212)產生該集成電路的寄存器傳輸級(RTL)方案(400);及在多個設計任務中交互式地定義或修改多個設計判斷。
            9.權利要求8的集成電路,其中交互式地定義或修改多個設計判斷的步驟包括對該算法描述的元素交互式地分配控制步映射(204)的步驟。
            10.權利要求8的集成電路,其中交互式地定義或修改多個設計判斷的步驟包括交互式地生成從該算法描述中的一個元素到某個RTL元件的結構映射的步驟。
            全文摘要
            用來實現設計集成電路的結構設計方法的計算機。生成該集成電路的行為的算法描述(步驟202),通過執行一組設計任務(步驟204-212)由該算法描述產生該集成電路的寄存器傳輸級邏輯(RTL)方案(400,500)。完成了一個設計任務后,可以通過轉移到另一個設計任務來修改該RTL方案,從而該設計可以任何次序完成。數據存儲在共用數據庫(12)中,通過多個數據編輯器(14-22)可以交互式地對其進行編輯。
            文檔編號G06F17/50GK1195825SQ9712306
            公開日1998年10月14日 申請日期1997年12月2日 優先權日1996年12月3日
            發明者卡漢·庫克查卡, 陳遲彤, 威爾赫姆斯·J·菲利普森, 托馬斯·E·塔卡西克 申請人:摩托羅拉公司
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